數(shù)字邏輯

1 邏輯理論基礎(chǔ)
1.1 概述
1.1.1 數(shù)字邏輯研究的對(duì)象及方法
1.1.2 數(shù)字邏輯的應(yīng)用與發(fā)展
1.2 數(shù)制及其轉(zhuǎn)換
1.2.1 進(jìn)位計(jì)數(shù)制
1.2.2 數(shù)制轉(zhuǎn)換
1.3 帶符號(hào)的二進(jìn)制數(shù)的代碼表示
1.3.1 原碼
1.3.2 反碼
1.3.3 補(bǔ)碼
1.3.4 浮點(diǎn)數(shù)的二進(jìn)制數(shù)
1.4 編碼
1.4.1 二進(jìn)制編碼
1.4.2 二一十進(jìn)制編碼
1.4.3 可靠性編碼
1.4.4 字符編碼
本章小結(jié)
復(fù)習(xí)思考題與習(xí)題
2 邏輯代數(shù)基礎(chǔ)
2.1 邏輯函數(shù)
2.1.1 邏輯函數(shù)的基本概念
2.1.2 邏輯函數(shù)的表示方法
2.1.3 基本邏輯運(yùn)算
2.2 邏輯代數(shù)
2.2.1 邏輯代數(shù)的基本定律
2.2.2 邏輯代數(shù)的基本規(guī)則
2.2.3 邏輯函數(shù)表達(dá)式的形式
2.3 邏輯函數(shù)的化簡(jiǎn)
2.3.1 用代數(shù)法化簡(jiǎn)邏輯函數(shù)
2.3.2 用卡諾圖化簡(jiǎn)邏輯函數(shù)
2.3.3 用蘊(yùn)涵法化簡(jiǎn)邏輯函數(shù)
本章小結(jié)
復(fù)習(xí)思考題與習(xí)題
3 組合邏輯
3.1 門(mén)電路
3.1.1 簡(jiǎn)單邏輯門(mén)電路
3.1.2 復(fù)合邏輯門(mén)電路
3.1.3 門(mén)電路的實(shí)現(xiàn)
3.2 組合邏輯分析
3.2.1 分析方法概述
3.2.2 分析舉例
3.3 組合邏輯設(shè)計(jì)
3.3.1 設(shè)計(jì)方法概述
3.3.2 邏輯問(wèn)題的描述
3.3.3 設(shè)計(jì)舉例
3.3.4 特殊問(wèn)題的邏輯設(shè)計(jì)
3.4 組合邏輯電路的險(xiǎn)象
3.4.1 險(xiǎn)象的產(chǎn)生
3.4.2 險(xiǎn)象的判斷
3.4.3 險(xiǎn)象的消除
3.5 常用的中規(guī)模組合邏輯標(biāo)準(zhǔn)構(gòu)件
3.5.1 譯碼器和編碼器
3.5.2 數(shù)據(jù)選擇器和數(shù)據(jù)分配器
3.5.3 數(shù)據(jù)比較器
3.5.4 加法器
本章小結(jié)
復(fù)習(xí)思考題與習(xí)題
4 時(shí)序邏輯電路
4.1 時(shí)序邏輯電路的結(jié)構(gòu)模型與分類(lèi)
4.1.1 結(jié)構(gòu)模型
4.1.2 時(shí)序邏輯電路的分類(lèi)
4.2 同步時(shí)序邏輯電路的分析
4.2.1 同步時(shí)序邏輯電路的結(jié)構(gòu)模型
4.2.2 同步時(shí)序邏輯電路的描述方法
4.2.3 觸發(fā)器
4.2.4 同步時(shí)序邏輯電路的分析方法
4.3 同步時(shí)序邏輯電路的設(shè)計(jì)
4.3.1 建立原始狀態(tài)圖和狀態(tài)表
4.3.2 狀態(tài)化簡(jiǎn)
4.3.3 狀態(tài)編碼
4.3.4 確定激勵(lì)函數(shù)和輸出函數(shù)
4.3.5 設(shè)計(jì)舉例
4.4 異步時(shí)序邏輯電路
4.4.1 異步時(shí)序邏輯電路的結(jié)構(gòu)模型
4.4.2 脈沖異步時(shí)序邏輯電路分析和設(shè)計(jì)
4.4.3 電平異步時(shí)序邏輯電路分析和設(shè)計(jì)
4.5 常用中大規(guī)模時(shí)序邏輯功能電路
4.5.1 計(jì)數(shù)器
本章小結(jié)
復(fù)習(xí)思考題與習(xí)題
5 編程邏輯
5.1 存儲(chǔ)器
5.1.1 RAM
5.1.2 RoM
5.1.3 半導(dǎo)體存儲(chǔ)芯片接口原理
5.1.4 ROM陣列結(jié)構(gòu)示意圖
5.2 可編程邏輯器件
5.2.1 PLA
5.2.2 PAL
5.2.3 GAL
5.2.4 CPLD
5.2.5 FPGA
5.3 硬件描述語(yǔ)言
5.3.1 ABEL語(yǔ)言
5.3.2 VHDL語(yǔ)言
5.3.3 Verilog HDL語(yǔ)言
5.4 設(shè)計(jì)方法
5.4.1 HDL的設(shè)計(jì)實(shí)現(xiàn)
5.4.2 組合型邏輯設(shè)計(jì)
5.4.3 寄存器型邏輯設(shè)計(jì)
本章小結(jié)
復(fù)習(xí)思考題與習(xí)題
6 數(shù)字系統(tǒng)設(shè)計(jì)
6.1 數(shù)字系統(tǒng)概述
6.1.1 數(shù)字系統(tǒng)基本概念
6.1.2 數(shù)字系統(tǒng)設(shè)計(jì)的一般過(guò)程
6.1.3 數(shù)字系統(tǒng)設(shè)計(jì)的常用工具
6.1.4 數(shù)字系統(tǒng)的實(shí)現(xiàn)方法
6.2 數(shù)據(jù)子系統(tǒng)設(shè)計(jì)
6.2.1 數(shù)據(jù)子系統(tǒng)功能
6.2.2 數(shù)據(jù)子系統(tǒng)的實(shí)現(xiàn)方法
6.3 控制子系統(tǒng)設(shè)計(jì)
6.3.1 控制子系統(tǒng)基本概念
6.3.2 算法狀態(tài)機(jī)（ASM）
6.3.3 小型控制器的設(shè)計(jì)
6.3.4 微程序控制器的設(shè)計(jì)
本章小結(jié)
復(fù)習(xí)思考題與習(xí)題
參考文獻(xiàn)